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 इंटेल ने अपने टाइगर लेक सीपस में और अधिक l3 कैश जोड़ा techpowerup - इंटेल

इंटेल अपने टाइगर लेक सीपीयू में अधिक L3 कैश जोड़ता है

InstLatX64 has posted a CPU dump of Intel's next-generation 10 nm CPUs codenamed Tiger Lake. With the CPUID of 806C0, this Tiger Lake chip runs at 1000 MHz base and 3400 MHz boost clocks which is lower than the current Ice Lake models, but that is to be expected given that this might be just an engineering sample, meaning that production/consumer revision will have better frequency.

शायद सबसे दिलचस्प निष्कर्षों में से एक यह डंप शो नए एल 3 कैश कॉन्फ़िगरेशन है। अब तक इंटेल आमतौर पर प्रत्येक कोर पर 2 एमबी एल 3 कैश डालता है, हालांकि टाइगर लेक के साथ ऐसा लगता है कि उपलब्ध कैश की मात्रा को बढ़ावा देना है। अब हम इस चार-कोर चिप के लिए कुल 3% या 12 MB के परिणामस्वरूप 50% अधिक L3 कैश प्राप्त करने जा रहे हैं। कैश की बेहतर क्षमता के कारण अतिरिक्त विलंबता हो सकती है क्योंकि अतिरिक्त दूरी डेटा को कैश में आने और बाहर जाने की आवश्यकता होती है, लेकिन इंटेल के इंजीनियरों ने निश्चित रूप से इस समस्या को हल किया है। इसके अतिरिक्त, पूर्ण AVX512 समर्थन avx512_bf को छोड़कर मौजूद है जो कूपर लेक ज़ीओन्स में पाए जाने वाले bfloat16 फ़्लोटिंग-पॉइंट भिन्नता का समर्थन करता है।
Source: InstLatX64